Ich möchte verschiedene Multi-Core-Hardware mit Risc V und Spike emulieren, aber ich habe wirklich Mühe, Dokumentation zu finden: zum Beispiel weiß ich nicht einmal, wo eine typische RISC-V Der Prozessor beginnt die Ausführung beim Zurücksetzen und scheint diese Informationen nicht in der ISA-Dokumentation zu finden.RISC-V und Spike: einige sehr grundlegende Fragen
Ist die Antwort auf die Spike-Quellen zu sehen? Oder gibt es noch andere Unterlagen, die ich vermisst habe?